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CD4518组成的数字钟电路(cd4518引脚图及功能表与

CD4518组成的数字钟电路(cd4518引脚图及功能表与

  CD4518是一个双BCD同步加计数器,由两个雷同的同步4级计数器构成。

  CD4518/CC4518是二、十进制(8421编码)同步加计数器,内含两个单位的加计数器,其性能外如真值外所示。每单个单位有两个时钟输入端CLK和EN,可用时钟脉冲的上升沿或低落沿触发。由外可知,若用ENABLE信号低落沿触发,触发信号由EN端输入,CLK端置“0”;若用CL℃K信号上升沿触发,触发信号由CL℃K端输入,ENABLE端置“1”。RESET端是清零端,RESET端置“1”时,计数器各端输出端Q1~Q4均为“0”,只要RESET端置“0”时,CD4518才入手计数。

  CD4518采用并行进位形式,只须输入一个时钟脉冲,计数单位Q1翻转一次;当Q1为1,Q4为0时,每输入一个时钟脉冲,计数单位Q2翻转一次;当Q1=Q2=1时,每输入一个时钟脉冲Q3翻转一次;当Q1=Q2=Q3=1或Q1=Q4=1时,每输入一个时钟脉冲Q4翻转一次。如此从初始状况(“0”态)入手计数,每输入10个时钟脉冲,计数单位便自愿规复到“0”态。若将第一个加计数器的输出端Q4A举动第二个加计数器的输入端ENB的时钟脉冲信号,便可构成两位8421编码计数器,顺序下去能够实行众位串行计数。CD4520/CC4520为二进制加计数器,由两个雷同的内同步4级计数器组成。计数器级为D型触发器,具有内部可互换CP和EN线,用于正在时钟上升沿或低落沿加计数。正在单个单位运算中,EN输入连结高电平,且正在CP上升沿进位。CR线为高电平淡,计数器清零。计数器正在脉动形式可级联,通过将Q3相连至下计数器的EN输入端可杀青级联,同时后者的CP输入连结低电平。

  其脉冲式用NE555发生的一个2000Hz的脉冲,用CD4518实行四次分频,使其频率抵达1Hz,用此频率对数字钟实行脉冲驱动。时、分、秒的计数用CD4518,区分用一片杀青对时、分、秒的计数,正在此必要用到再有74LS00和74LS04,用其实行复位。译码器电道采用74LS47对数码显示管实行驱动。

  CD4518支配性能:CD4518有两个时钟输入端CP和EN,若用时钟上升沿触发,信号由CP输入,此时EN端为高电平(1),若用时钟低落沿触发,信号由EN输入,此时CP端为低吨平(0),同时复位端Cr也连结低电平(0),只要知足了这些条目时,电道才会处于计数状况。不然没举措做事。

  图中CD4518的清零端相连了三个二极管,二极管具有单指导通特征,使每个清零端之间没有影响,当清零端为高电位的功夫实行清零,于是,按下清零开合,清零端为高电位,时、分、秒清零。

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